数字电子技术课程设计心得（小编推荐）

第一篇：数字电子技术课程设计心得（小编推荐）

经过差不多一个星期的奋战，我的抢答器终于完成了。在给老师检查的那一刻，突然有一种如释重负的感觉，从星期二道星期五，除上课以外的所有时间我都花在这里了，甚至连吃饭的时间都省掉，就为了这块小小的电路板。幸好，结果没有让我太失望。虽然对于其他的同学来说完成的比较晚，但是我却很欣慰，因为所有的东西都是自己完成的，电路板上的每一根线，每一个芯片，都是我自己安上去的，最重要的是，制作过程中所有的错误也都是自己找出来并更正的。其实在焊板之前，我并没有下这么大的决心。心里总是有一种要别人帮助的期望，但是真正在焊板的时候才猛然发觉，原来我们班级选择抢答器的就只有四位同学，更糟糕的是做在我们前面的自动化专业没有抢答器这个选项。当时一下子就愣了，不知道在交板的时候我会是怎样一种情况：是没有实验现象；没做完；或是更糟糕的结果。我不敢想象。现在，我已经走出了那个实验室，仔细想一想，从领板到交板，这一过程，让我受益匪浅：

1． 器材领到了，心里总想着要快点开始。所以，拿着东西就立刻行动。因为之前根对所有本就对所有东西一无所知，只看到其他同学都拿着东西往板上装，我也就跟着做。可是，等我所有的引脚都装上去了才被同学告知，板上的孔是每三个用一个铜片相连的，也就是说，他们三个孔是相同的，在安装的时候必须把他们隔开，可是，我却完全没有注意到这个问题，那一刻，真的感到一种很强烈的挫败感。以为，这个实验就这么被我弄砸了。不幸中的万幸是，一般的引脚之间的距离都在三个孔以上，所以那些

不可能安错，只有一个装555芯片的引脚比较小。最后，在同学的帮助下，成功的帮我卸下了那个芯片引脚，我才能重新开始。

2． 装完引脚之后，我开始布线。很快，我又遇到了一个严重的问题。就是因为在实验之前完全没有考虑过布线的问题，芯片的引脚都是凭自己的感觉胡乱装上去的，根本没有足够的空间布出一副整齐的线路。但是因为所有的引脚都已经安装上去了，已经没有修改的余地，我也只能死马当活马医，尽最大努力去布出每一根线。等布线完成之后一看，线路歪歪斜斜，没有规律，更谈不上美观。再看一下其他某些同学的线路。有的简直可以用艺术二字来形容。但是，没有办法，我只能接着往下做。

3． 等布线完成后，就开始测试了。我们这个抢答器的实验有等两部分：主电路和扩展电路。而且二者之间是分开的。我上面做的就只是主电路部分。可是等我接通电源一看，没有一点反应，那几根数码管根本就没有亮起来的念头。我只有很无奈的开始进行检查，没有发现问题。一直到傍晚，我都停留在这个部分，没有一点进展，而周围有的做其他实验的同学已经完成的差不多了，甚至已经有了实验结果。而我，一直等到星期四下午才把主电路部分完成。在主电路的检查过称中，大致发现了一下几个我的问题：

（一）每个芯片都有一个电源脚和一个地脚。而我在一开始的时

候竟然忘记了，这也就是一开始那个显示器没有任何显示的原因。这也是我做这个实验犯过的最严重的一个错误。

（二）开关问题。我们使用的开关跟仿真图上的开关不一样，仿

真图上有多种开关可以选用。但是提供给我们做实物图的开关就只有一种。（如下图示）

在未接通时，1脚和3脚是接通的，2脚和4脚是接通的。但是在按下开关后，四个脚全部是接通的。在一开始，我把1脚和芯片对应的引脚相连，4脚和地相连，但是把三脚直接接5伏电源，而没有接电阻（因为仿真图上没有电阻）。后面才发现，当把开关按下后，地和电源是直接接通的。所以在未接电阻时，也没有正确的结果。

（三）电阻问题。知道做完实验后才发现，电阻是实验过程中非

常重要的一部分。这在我后面帮同学检查线路的时候也发现了。那份线路没有其他任何问题，就是把74LS279上面引出来的引脚与电源之间的那个电阻用的是5K，但是就是没有结果，当我把那个电阻换成510欧姆的电阻之后，所有实验现象就全出来了。而我自己开始的时候也是把那个电阻忘记了，也是一直没有看到正确的显示。

（四）芯片引脚。我们这个电路用到了74LS279。而我一开始就

按照仿真图上的做法，直接用了两个279芯片。后面才知道其

实只要一个芯片就可以。这当然也是归结于自己开始的准备工作没有做好。因为没有认真仔细的看清楚每个芯片的使用情况。还有译码显示管的引脚，等我连好线路图的时候才发现我在网上找的那个引脚图是错误的。

（五）连线。连线实际上也是制作电路板一个非常重要的方面。

连接过程中要时刻注意有没有短路，有没有断路。在进行了很多次的修改之后，我的板上还是不能正确显示所有的结果。结果还是0，0，2，2，4，4，6，7。根本没有1,3,5这几个数字。经过几轮仔细的检查后，才发现我的其中一个279芯片的引脚虽然看上去像连接在一起了，但是实际上他们之间并没有通电。等更正过来后，终于0到7八个数字全部能过正确显示。虽然这个过程非常漫长，但是，我却有点享受其中的感觉。在老师检查过后，老师又提出了另外一个问题：把0到7这几个数字改成1到

8。心里想想也是，抢答器当然是希望数字一对一。而像我这种做法就是一号选手编号为0，二号选手编号为1„„，八号选手编号为7。这样当然会不方便。

做完主电路后，就开始做扩展电路。有了前面做主电路的经验，所以在做扩展电路的时候就少走了很多弯路。但还是经过了一番曲折之后才看到实验结果。

（一）首先也是开关问题。这次虽然接了电阻，但是我却把接

74LS192芯片的引脚4和引脚五分别接电阻改成了两端直接相连接一个电阻。其实，这在仿真图上是可以的。但是就是

因为开关的不同导致接线的不同。后面我才发现，几乎我们四个做抢答器实验的同学都犯了这个错误。

（二）在做扩展电那个路图时，我还发现了一个非常奇怪的问

题。因为我的仿真图上74LS48与显示管之间是接了排阻的，但是在连接实物图时，为了节省位置，所以想把排阻去掉，但是在仿真图上操作时，却发现不能去掉排阻。可是事实上其他实验中都用到了这两个芯片，而且都没有接排阻。后来，问了同学才知道，原来在仿真图上去掉排阻就必须把显示管上的接地端改成接GND端。这也让我意识到，虽然，Multism容易掌握，但是实际上他有很多东西是不能随便使用的。扩展电路比主电路完成要顺利很多，所谓“实践出真知”也就是这个道理吧。虽然，现在的我们因为面临考试的原因时间变得非常紧张，而且这周也基本上完全没有进行考试准备，反而觉得非常充实。也让我有了很多体会：

1、团队合作比较重要。开始的时候我一个人做，出现问题时候，自己找了好久才发现问题的所在。但是有几次问了下同学或是和同学一起探讨，问题很快就解决了。这也就是人多力量大吧，集思广益，能把问题解决得更好。

2、焊接是一个锻炼人动手能力的过程。要使自己的布线美观而且焊接时有没有虚焊，这要一个人要有耐心和细心。

3．做任何事情之前一定要认真做好准备。这样才能未雨绸缪，做到

临危不乱。如果所有的事情都等到发生了之后再去想办法就已经来不及了。

3、这次课程设计给了我们一个很好的提高动手能力的机会。平常我们只是在头脑中去抽象的记忆、理解那些课本上的理论知识。有的理论知识好像很懂，但是有的理论知识确是晦涩难懂的，甚至只是靠自己的死记硬背去记住。但是我们都知道，那样的记忆只是一时的，很快你就会忘记。而这次的实习却给了我们一个在实践中灵活运用知识的机会，我们通过在实践中发现问题，进而去书本中找相关的知识去解决问题，从而巩固了理论知识。那样的知识是你从根本上去认识它，理解它，所以你的记忆时间会很长。就像这次我对用过的这些芯片的引脚功能已经很熟悉一样。我要感谢老师的细心教导和同学们的大力帮助，我相信这几天的不懈努力会给我未来的学习带来很多的启发,我会在以后的工作生活中更好的理论联系实际, 扎扎实实走好每一步。

第二篇：数字电子技术课程设计（模版）

数字电子技术课程设计

一、设计题目

1、多功能数字钟的设计

设计要求：设计一个多功能数字钟，要求能准确计时，并以数字形式显示时、分、秒的时间，能校正时间。

2、数字频率计的设计

设计要求：设计一个数字频率计，要求可以测量方波、正弦波、三角波的频率，并以四位十进制数字表示。

3、多路数字式竞赛抢答器的设计

设计要求：设计一个可供六组参赛的数字式竞赛抢答器，每组设计一个抢答按钮，要求具有第一抢答信号的鉴别和锁存功能，具有计分及计时功能，设置犯规报警。

4、病房呼叫系统

设计要求：用1~5个开关模拟5个病房的呼叫输入信号，1号优先级最高；1~5优先级依次降低； 用一个数码管显示呼叫信号的号码；没信号呼叫时显示0；有多个信号呼叫时，显示优先级最高的呼叫号（其它呼叫号用指示灯显示）；凡有呼叫发出的呼叫声；对低优先级的呼叫进行存储，处理完高优先级的呼叫，再进行低优先级呼叫的处理。

5、篮球24S倒计时

设计要求：具有显示24S计时功能；设置外部操作开关，控制计时器的直接清零、启动和暂停连续功能计时器为24S递减计时器，其计时时间间隔为1S，计时器减计时到零时，发出报警信号。

6、16路数显报警器

设计要求：设计16路数显报警器，16路中某一路断开时（可用高低电平表示断开和接通），用十进制数显示该路编号，并发出声音信号；报警时间持续10秒钟；当多路报警时，要有优先级，并将低优先级的报警存储，处理完高优先级报警后，再处理之。

7、六十进制计数器。

设计要求：能实现六十进制计数，采用数码显示数字，有暂停功能，方波产生电路可不必设计。

8、电子门铃

设计要求：设计一个电子门铃，响声为“嘀嘀”声，或者叮咚声等；响声持续20S9、故障指示电路

设计要求：

1、一台设备出故障，黄灯亮；两台设备出故障，红灯亮；三台设备出故障，黄灯和红灯都亮。

2、设备工作或故障可用开关来模拟

二、课程设计说明书与图纸要求

课程设计说明书包括内容：

1．设计任务及主要技术指标和要求；

2．选定方案的论证及整体电路的工作原理；

3．单元电路的设计计算，元器件选择，电路图；

4． 按国家有关标准画出整体电路图，列出元件、器件明细表；

5．对设计成果作出评价，说明本设计特点和存在的问题，提出改进意见，心得体会。

第三篇：数字电子技术基础课程设计

苏州科技大学 电子与信息工程学院 数字电子技术基础课程设计报告

电子1412

姓名：孙玮

苏州科技大学 电子与信息工程学院

数字电子技术基础课程设计报告

专业班级：电子1412 学号：14200106214

姓名：孙玮

指导教师：潘欣裕

2016年

07月

03日

苏州科技大学 电子与信息工程学院 数字电子技术基础课程设计报告

电子1412

姓名：孙玮

一、基础部分（共55分，利用下列芯片，构建出具有验证其逻辑或时序功能的系统，实现仿真电路，并附详细参数计算及说明）1.1、基于74138、74148编码、解码系统。（10分）

图1

图2 苏州科技大学 电子与信息工程学院 数字电子技术基础课程设计报告

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姓名：孙玮

图1为编码器电路，图2为解码器电路。他们的逻辑转换表如下所示。

图3

图4 74HC148在S=0电路正常的工作状态下，允许I0~ I7当中同时有几个输入端为低电

’’平，即有编码输入信号。I7的优先级最高，I0的优先级最低。当有多个输入时，编码器只

’’’会对优先级最高的进行编码，优先级较低的不会进行编码。当出现Y2、Y1、Y0都为0时，’’’可以用Ys和Yex的不同状态来区分。只有当S为0时。编码器才会工作，不为0 时，编码

’’器不工作，输出均为1。有输入时Ys为1，Yex为0，当使用两片接成16-4编码器时，第一’’片的Ys连到第二片的S。

’’ 74HC138只有当S1=1，且S2=S3=0时才会工作。数据由S1段输入，由A2A1A0来确定输出口，所以S1成为数据输入端，A2A1A0为地址输入端，以反码输出。

将73HC148的输出作为74HC138的地址输入可以实现完整的编码解码电路。’

’

’1.2、基于74161或74160的计数电路。（10分）苏州科技大学 电子与信息工程学院 数字电子技术基础课程设计报告

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图5 图5所示为基于74HC161的计数电路。该电路是由两片74HC161级联实现的256进制计数器。其输入端逻辑电平如下图所示。

图6

’74HC161为十六进制计数器，其从0000到1111计数。RD为0时，74HC161不论其他引

’’脚的接法直接异步置零，当CLK为上升沿时，且RD为1，LD=0是芯片工作在预置数状态，’’同步置数；CLK上升沿，RD=LD=1，芯片处于计数状态，每来一次上升沿，芯片会有一次加一。图中芯片处于计数状态，~LOAD和~CLR接1，ENP与ENT接1，芯片开始正常计数。当数据加到1111时，在RCO处产生进位。此外，通过多个级联可以实现多进制的计数器。

1.3、基于74151数据选择器的功能电路。（10分）

图7所示为基于74151数据选择器的功能电路。图8所示为74151数据选择器的逻辑转换表。74151是八选一的数据选择器，使用ABC输入地址代码，可以选择八个数据中的一个，并在Y输出，~W输出Y的取反值。例如如图中所示，当输入为D0=D1=D2=D4=D5=1，D3=D6=D7=0，A=0，B=C=1，数据选择器选择了D3，所以表现在二极管上是不导通。

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姓名：孙玮

图7

图8 1.4、基于JK触发器的时序电路。（10分）

图9 图9所示为由四个JK触发器构成的十六进制计数电路。其输出波形如下图所示。

图10 苏州科技大学 电子与信息工程学院 数字电子技术基础课程设计报告

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由图可见，各触发器驱动方程分别为T0=1 T1=Q0 T2=Q0Q1 T3=Q0Q1Q2。将上式代入T触发器

*’*’’*’（由JK触发器构成）的特性方程可得Q0=Q0Q1=Q0Q1+Q0Q1 Q2=Q0Q1Q2 *’’’Q3=Q0Q1Q2Q3+(Q0Q1Q2)Q3+(Q0Q1Q2)Q3。电路输出方程为C= Q0Q1Q2Q3。其电路状态转换表如下图所示。

图11

1.5、555的信号产生电路、施密特触发电路各一个。（15分）

图12 如图12所示为基于施密特触发器的整波电路。它的功能是将正弦波转化为方波信号。仿真的示波器截图如下图所示。苏州科技大学 电子与信息工程学院 数字电子技术基础课程设计报告

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姓名：孙玮

图13 如图14所示为基于555定时器的多谐振荡电路。其充电周期T1=Ln2*（R1+R2）C2，放电周期T2=Ln2*R1*C2，T=T1+T2。因此，图中电路所产生信号频率为f=1/T=476Hz。测量波形如下图所示。

图14 苏州科技大学 电子与信息工程学院 数字电子技术基础课程设计报告

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二、提高部分（40分）

2.1、制作一个时钟电路，具有时、分、秒显示、重置、预置等功能，要求写出必要的设计过程，并画出对应的逻辑图，实现仿真。（15分）计数部分截图如图15所示；置数如图16所示；复位如图17所示。

1、秒钟设计：

秒钟是六十进制，用两片74HC160实现，第一片作为秒，十进制，第二片作为十秒，设置成六进制，并将第一片的进位信号连接到第二片的ENT与ENP；秒位满十进制进位溢出给十秒位计数信号，所以秒位计十次，十秒位计一次，从而实现六十进制。74HC160输出端接数码管读出计数。

2、分钟设计：

原理和秒钟一样，也是采用六十进制。

3、时钟设计：

时钟与之前两个不一样，设置为二十四进制，整体进行置数，当时钟达到24时直接置零，从头开始计数。

4、秒钟与分钟之间的连接：

当秒钟计到59时，会对分钟产生进位。所以用与门将秒位的二进制九和十秒位上的二进制五通过与门连接到分钟的ENT/ENP使得分钟正常计数开始，从而实现秒钟计数六十次，分钟计数一次。

5、分钟与时钟的连接：

原理与秒钟和分钟的连接类似，将秒钟和分钟上的二进制位的59通过一个与门连接到时钟的ENP/ENT，使得时钟得以正常计数，从而实现分钟计数60，时钟计数一次。

6、整体时钟的置零：

将各个位的CLR位引出来和六进制的复位连线经与门之后连接到单刀双掷开关上，CLR是低电平有效，所以当单刀双掷开关接地时，整个时钟电路时置零。

7、整体时钟电路置数：

将每一片的74HC160的输入端连接到一个开关，通过控制开关的连接控制输入1或者0。将所有芯片的Load端引至一个单刀双掷开关，低电平有效，从而实现同时置数。

以上就是设计时钟电路的简要思路。

图15 苏州科技大学 电子与信息工程学院 数字电子技术基础课程设计报告

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姓名：孙玮

图16

图17

2.2、用两片四位全加器74283和必要的逻辑门设计一个数制转换电路，实现将输入的两位十进制数转换成二进制数，十进制数的输入采用8421BCD码来表示，要求写出必要的设计过程，并画出对应的逻辑图，实现仿真。（15分）

图18 苏州科技大学 电子与信息工程学院 数字电子技术基础课程设计报告

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姓名：孙玮

如图18所示为仿真的截图。其左端输入BCD码10001001，右端LED显示的是01011001，均分别为十进制数89。设计思路：

假设有一个两位十进制数X，其对应的八位BCD码为ABCDEFGH，即ABCD*(10000)BCD +EFGH=(X)10。上式=ABCD*（1000）B+ABCD*（10）B+EFGH，所以二进制为ABCD000+ABCD0 +EFGH=ABCD000+ ABCD0+0EFG0+H。由上式可知，H可以直接输出，其为二进制的最低位。然后我们可以用第一片74283将ABCD与0EFG求和，将得到的结果设为KLMN，进位为O。于是二进制数可以表示为KLMN0+ O00000+ABCD000+H。由此可见，M与N分别为二进制的倒数第三与第二位。而其前四位可由74283将ABCD与OKL相加得到，最终输出七位二进制数。

2.3、自主设计一个具有特定功能，且包含4个以上不同类型芯片的系统，要求写出必要的设计过程，并画出对应的逻辑图，实现仿真。（10分）

本部分我自主设计了一个四位二进制乘法器，其仿真截图如下所示。图中两个输入端分别输入了1011与1101，其乘法运算结果为10001111，与仿真结果相符。

图19 苏州科技大学 电子与信息工程学院 数字电子技术基础课程设计报告

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姓名：孙玮

设计思路：

假设一个四位二进制数为ABCD，另外一个为EFGH，则其相乘的运算过程为：ABCD*EFGH=(A*E)(B*E)(C*E)(D*E)000+(A*F)(B*F)(C*F)(D*F)00+(A*G)(B*G)(C*G)(D*G)0+(A*H)(B*H)(C*H)(D*H)。因此我们可以将EFGH每一位提出来与ABCD每一位相乘，然后将其加起来求和。这里提出EFGH中每一位的过程可以通过移位寄存器实现。此外，因为74HC283只能实现4位二进制的全加过程，因此每次相加完都需要将和的最低位取出进行保存。此处保存使用移位寄存器（因为前面我们使用了移位寄存器，且其也移动四位，所以可以使用前面使用的移位寄存器来实现数据的保存）。另外，因为74HC283不是时序逻辑电路，所以需要将它输出的用于下一步求和的数据（此处的数据为求和结果的高三位与进位）存于寄存器中。等待下个上升沿到来后，将数据传输到74HC283的B输入口（B4输入进位，B3~B1输入前一次求和结果的高三位）。由此，经过四个周期之后，乘法运算就全部计算完毕。但由于在运行完四个周期后还会继续运行，导致数据无法保存，所以需要加一个计数器（这里采用74HC160）。当计数计到0100的时候，通过逻辑电路将时钟信号与计数器停止。下次运行时只需摁下复位开关将寄存器与计数器复位即可进行下次运算。

第四篇：数字电子技术电路课程设计

数字电子技术电路课程设计

题 目：数字时钟说明书

所在学院：信息工程学院

专 业：通信工程

班 级：

授课教师：

小组成员：

时 间：

16--1

2014-6-10

数字时钟说明书

数字钟是一种用数字电子技术实现时，分，秒计时的装置，具有较高的准确性和直 观性等各方面的优势，而得到广泛的应用。此次设计数字电子钟是为了了解数字钟的原理，在设计数字电子钟的过程中，用 数字电子技术的理论和制作实践相结合，进一步加深数字电子技术课程知识的理解和应用，同时学会使用Multisim电子设计软件。

一、设计目的

1.熟悉集成电路的引脚安排.2.掌握各芯片的逻辑功能及使用方法.3.了解面包板结构及其接线方法.4.了解数字钟的组成及工作原理.5.熟悉数字钟的设计与制作.二、设 计 要求

1.显示时，分，秒，用24小时制 2.能够进行校时，可以对数字钟进行调时间 1.设计指标

时间以24小时为一个周期;显示时,分,秒;有校时功能,可以分别对时及分进行单独校时,使其校正到标准时间;为了保证计时的稳定及准确须由晶体振荡器提供表针时间基准信号.画出电路原理图(或仿真电路图);判断元器件及参数选择;电路仿真与调试;PCB文件生成与打印输出.3.制作要求 自行装配和调试,并能发现问题和解决问题.4.编写设计报告 写出设计与制作的全过程,附上有关资料和图纸,有心得体会.1.数字钟的构成

数字钟实际上是一个对标准频率(1HZ)进行计数的计数电路.由于计数的起始时间不可能与标准时间(如北京时间)一致,故需要在电路上加一个校时电路,同时标准的1HZ时间信号必须做到准确稳定.通常使用石英晶体振荡器电路构成数字钟.图 3-1所示为数字钟的一般构成框图.1.秒脉冲发生器 脉冲发生器是数字钟的核心部分，它的精度和稳定度决定了数字钟的质量，通常用晶体振荡器发出的脉冲经过整形、分频获得1Hz的秒脉冲。如晶振为32768 Hz，通过15次二分频后可获得1Hz的脉冲输出.2.计数译码显示

秒、分、时、日分别为60、60、24、7进制计数器、秒、分均为60进制，即显示00～59，它们的个位为十进制，十位为六进制。时为二十四进制计数器，显示为00～23，个位仍为十进制，而十位为三进制，但当十进位计到2，而个位计到4时清零，就为二十四进制了。

⑴晶体振荡器电路

晶体振荡器电路给数字钟提供一个频率稳定准确的32768Hz的方波信号,可保证数字钟的走时准确及稳定.不管是指针式的电子钟还是数字显示的电子钟都使用了晶体振荡器电路.⑵分频器电路

分频器电路将32768Hz的高频方波信号经32768()次分频后得到1Hz的方波信号供秒计数器进行计数.分频器实际上也就是计数器.⑶时间计数器电路

时间计数电路由秒个位和秒十位计数器,分个位和分十位计数器及时个位和时十位计数器电路构成,其中秒个位和秒十位计数器,分个位和分十位计数器为60进制计数器,而根据设计要求,时个位和时十位计数器为12进制计数器.⑷译码驱动电路

译码驱动电路将计数器输出的8421BCD码转换为数码管需要的逻辑状态,并且为保证数码管正常工作提供足够的工作电流.⑸数码管

数码管通常有发光二极管(LED)数码管和液晶(LCD)数码管,本设计提供的为LED数码管.2.数字钟的工作原理 1)晶体振荡器电路

晶体振荡器是构成数字式时钟的核心,它保证了时钟的走时准确及稳定.晶体XTAL的频率选为32768HZ.该元件专为数字钟电路而设计,其频率较低,有利于减少分频器级数.当要求频率准确度和稳定度更高时,还可接入校正电容并采取温度补偿措施.由于CMOS电路的输入阻抗极高,因此反馈电阻R1可选为1.8KΩ.较高的反馈电阻有利于提高振荡频率的稳定性.2)分频器电路

通常,数字钟的晶体振荡器输出频率较高,为了得到1Hz的秒信号输入,需要对振荡器的输出信号进行分频.通常实现分频器的电路是计数器电路,一般采用多级2进制计数器来实现.例如,将32768Hz的振荡信号分频为1HZ的分频倍数为32768(215),即实现该分频功能的计数器相当于15极2进制计数器.常用的2进制计数器有74HC393等.3）6进制计数器转换电路

分个位和分十位计数单元电路结构分别与秒个位和秒十位计数单元完全相同,只不过分个位计数单元的Q3作为向上的进位信号应与分十位计数单元的CPA相连,分十位计数单元的Q2作为向上的进位信号应与时个位计数单元的CPA相连.时个位计数单元电路结构仍与秒或个位计数单元相同,但是要求,整个时计数单元应为12进制计数器,不是10的整数倍,因此需将个位和十位计数单元合并为一个整体才能进行12进制转换.利用1片74HC390实现12进制计数功能的电路如图3-6所示.4)译码驱动及显示单元

计数器实现了对时间的累计以8421BCD码形式输出,选用显示译码电路将计数器的输出数码转换为数码显示器件所需要的输出逻辑和一定的电流,选用CD4511作为显示译码电路,选用LED数码管作为显示单元电路.5)校时电源电路

当重新接通电源或走时出现误差时都需要对时间进行校正.通常,校正时间的方法是:首先截断正常的计数通路,然后再进行人工出触发计数或将频率较高的方波信号加到需要校正的计数单元的输入端,校正好后,再转入正常计时状态即可.根据要求,数字钟应具有分校正和时校正功能,因此,应截断分个位和时个位的直接计数通路,并采用正常计时信号与校正信号可以随时切换的电路接入其中.图3-7所示即为带有基本RS触发器的校时电路, 1.实验中所需的器材 5V电源.面包板1块.示波器.万用表.镊子1把.剪刀1把.网络线2米/人.共阴八段数码管6个.HD74LS48P芯片6个.HD74LS90P芯片6个.HD74LS08P芯片2个.555芯片一个.1.8KΩ电阻一个.设计图为：

面包板内部结构图

面包板右边一列上五组竖的相通,下五组竖的相通,面包板的左边上下分四组,每组中X,Y列(0-15相通,16-40相通,41-55相通,ABCDE相通,FGHIJ相通,E和F之间不相通.个功能块电路图

一个CD4511和一个LED数码管连接成一个CD4511驱动电路,数码管可从0---9显示,以次来检查数码管的好坏,见附图5-1.利用一个LED数码管,一块CD4511,一块74HC390,一块74HC00连接成一个十进制计数器,电路在晶振的作用下数码管从0—9显示, 总接线元件布局简图,见附图6-1 芯片连接图见附图7-1 八,总结

设计过程中遇到的问题及其解决方法.在检测面包板状况的过程中,出现本该相通的地方却未通的状况,后经检验发现是由于万用表笔尖未与面包板内部垂直接触所至.在检测CD4511驱动电路的过程中发现数码管不能正常显示的状况,经检验发现主要是由于接触不良的问题,其中包括线的接触不良和芯片的接触不良,在实验过程中,数码管有几段二极管时隐时现,有时会消失.用5V电源对数码管进行检测,一端接地,另一端接触每一段二极管,发现二极管能正常显示的,再用万用表欧姆档检测每一根线是否接触良好,在检测过程中发现有几根线有时能接通,有时不能接通,把接触不好的线重新接过后发现能正常显示了.其次是由于芯片接触不良的问题,用万用表欧姆档检测有几个引脚本该相通的地方却未通,而检测的导线状况良好,其解决方法为把CD4511的芯片拔出,根据面包板孔的的状况重新调整其引脚,使其正对于孔,再用力均匀地将芯片插入面包板中,此后发现能正常显示,本次实验中还发现一块坏的LED数码管和两块坏的CD4511,经更换后均能正常显示.在连接晶振的过程中,晶振无法起振.在排除线与芯片的接触不良问题后重新对照电路图,发现是由于12脚未接地所至.在连接六进制的过程中,发现电路只能4,5的跳动,后经发现是由于接到与非门的引脚接错一根所至,经纠正后能正常显示.在连接校正电路的过程中,出现时和分都能正常校正时,但秒却受到影响,特别时一较分钟的时候秒乱跳,而不校时的时候,秒从40跳到59,然后又跳回40,分和秒之间无进位,电路在时,分,秒进位过程中能正常显示,故可排除芯片和连线的接触不良的问题.经检查,校正电路的连线没有错误,后用万用表的直流电压档带电检测秒十位的QA,QB,QC和QD脚,发现QA脚时有电压时而无电压,再检测秒到分和分到时的进位端,发现是由于秒到分的进位未拔掉所至.在制作报时电路的过程中,发现蜂鸣器在57分59秒的时候就开始报时,后经检测电路发现是由于把74HC30芯片当16引脚的芯片来接,以至接线都错位,重新接线后能正常报时.连接分频电路时,把时个位的QD和时十位的1脚断开,然后时十位的1脚接到晶振的3脚,时十位的3脚接到秒个位的1脚,所连接的电路图无法正常工作,时十位从0-9的跳,时个位只能显示一个0,在这个电路中3脚的分频用到两次,故无法正常显示,因此要把12进制接到74HC390的一个逻辑电路空出来用于分频即可,因此把时十位的CD4511的12,6脚接地,7脚改为接74HC390的5脚,74HC390的3,4脚断开,然后4脚接9脚即可,其中空出的74HC390的3脚就可用于2Hz的分频,分频后变为1Hz,整个电路也到此为正常的数字钟计数.2.设计体会

在此次的数字钟设计过程中,更进一步地熟悉了芯片的结构及掌握了各芯片的工作原理和其具体的使用方法.在连接六进制,十进制,六十进制的进位及十二进制的接法中,要求熟悉逻辑电路及其芯片各引脚的功能,那么在电路出错时便能准确地找出错误所在并及时纠正了.在设计电路中,往往是先仿真后连接实物图,但有时候仿真和电路连接并不是完全一致的,例如仿真的连接示意图中,往往没有接高电平的16脚或14脚以及接低电平的7脚或8脚,因此在实际的电路连接中往往容易遗漏.又例如74HC390芯片,其本身就是一个十进制计数器,在仿真电路中必须连接反馈线才能正常显示,而在实际电路中无需再连接,因此仿真图和电路连接图还是有一定区别的.在设计电路的连接图中出错的主要原因都是接线和芯片的接触不良以及接线的错误所引起的.3.对该设计的建议

此次的数字钟设计重在于仿真和接线,虽然能把电路图接出来,并能正常显示,但对于电路本身的原理并不是十分熟悉.总的来说,通过这次的设计实验更进一步地增强了实验的动手能力.

第五篇：数字电子技术课程设计报告

数字电子技术课程设计报告 题 目: 数字钟的设计与制作

学 年 学 期:

专 业 班 级: 学 号:

姓 名:

指导教师及职称: 时 间: 地点： 设计目的

熟悉集成电路的引脚安排.掌握各芯片的逻辑功能及使用方法.了解面包板结构及其接线方法.了解数字钟的组成及工作原理.熟悉数字钟的设计与制作.设计要求 1.设计指标

时间以24小时为一个周期;显示时,分,秒;有校时功能,可以分别对时及分进行单独校时,使其校正到标准时间;计时过程具有报时功能,当时间到达整点前5秒进行蜂鸣报时;为了保证计时的稳定及准确须由晶体振荡器提供表针时间基准信号.2.设计要求

画出电路原理图(或仿真电路图);元器件及参数选择;电路仿真与调试;PCB文件生成与打印输出.3.制作要求 自行装配和调试,并能发现问题和解决问题.4.编写设计报告 写出设计与制作的全过程,附上有关资料和图纸,有心得体会.设计原理及其框图 1.数字钟的构成

数字钟实际上是一个对标准频率(1HZ)进行计数的计数电路.由于计数的起始时间不可能与标准时间(如北京时间)一致,故需要在电路上加一个校时电路,同时标准的1HZ时间信号必须做到准确稳定.通常使用石英晶体振荡器电路构成数字钟.图 3-1所示为数字钟的一般构成框图.图3-1 数字钟的组成框图 ⑴晶体振荡器电路

晶体振荡器电路给数字钟提供一个频率稳定准确的32768Hz的方波信号,可保证数字钟的走时准确及稳定.不管是指针式的电子钟还是数字显示的电子钟都使用了晶体振荡器电路.⑵分频器电路 分频器电路将32768Hz的高频方波信号经32768()次分频后得到1Hz的方波信号供秒计数器进行计数.分频器实际上也就是计数器.⑶时间计数器电路

时间计数电路由秒个位和秒十位计数器,分个位和分十位计数器及时个位和时十位计数器电路构成,其中秒个位和秒十位计数器,分个位和分十位计数器为60进制计数器,而根据设计要求,时个位和时十位计数器为12进制计数器.⑷译码驱动电路

译码驱动电路将计数器输出的8421BCD码转换为数码管需要的逻辑状态,并且为保证数码管正常工作提供足够的工作电流.⑸数码管

数码管通常有发光二极管(LED)数码管和液晶(LCD)数码管,本设计提供的为LED数码管.2.数字钟的工作原理 1)晶体振荡器电路

晶体振荡器是构成数字式时钟的核心,它保证了时钟的走时准确及稳定.图3-2所示电路通过CMOS非门构成的输出为方波的数字式晶体振荡电路,这个电路中,CMOS非门U1与晶体,电容和电阻构成晶体振荡器电路,U2实现整形功能,将振荡器输出的近似于正弦波的波形转换为较理想的方波.输出反馈电 阻R1为非门提供偏置,使电路工作于放大区域,即非门的功能近似于一个高增益的反相放大器.电容C1,C2与晶体构成一个谐振型网络,完成对振荡频率的控制功能,同时提供了一个180度相移,从而和非门构成一个正反馈网络,实现了振荡器的功能.由于晶体具有较高的频率稳定性及准确性,从而保证了输出频率的稳定和准确.晶体XTAL的频率选为32768HZ.该元件专为数字钟电路而设计,其频率较低,有利于减少分频器级数.从有关手册中,可查得C1,C2均为30pF.当要求频率准确度和稳定度更高时,还可接入校正电容并采取温度补偿措施.由于CMOS电路的输入阻抗极高,因此反馈电阻R1可选为10MΩ.较高的反馈电阻有利于提高振荡频率的稳定性.非门电路可选74HC00.图3-2 COMS晶体振荡器 2)分频器电路

通常,数字钟的晶体振荡器输出频率较高,为了得到1Hz的秒信号输入,需要对振荡器的输出信号进行分频.通常实现分频器的电路是计数器电路,一般采用多级2进制计数器来实现.例如,将32768Hz的振荡信号分频为1HZ的分频倍数为32768(215),即实现该分频功能的计数器相当于15极2进制计数器.常用的2进制计数器有74HC393等.本实验中采用CD4060来构成分频电路.CD4060在数字集成电路中可实现的分频次数最高,而且CD4060还包含振荡电路所需的非门,使用更为方便.CD4060计数为14级2进制计数器,可以将32768HZ的信号分频为2HZ,其内部框图如图3-3所示,从图中可以看出,CD4060的时钟输入端两个串接的非门,因此可以直接实现振荡和分频的功能.图3-3 CD4046内部框图 3)时间计数单元

时间计数单元有时计数,分计数和秒计数等几个部分.时计数单元一般为12进制计数器计数器,其输出为两位8421BCD码形式;分计数和秒计数单元为60进制计数器,其输出也为8421BCD码.一般采用10进制计数器74HC390来实现时间计数单元的计数功能.为减少器件使用数量,可选74HC390,其内部逻辑框图如图 2.3所示.该器件为双2—5-10异步计数器,并且每一计数器均提供一个异步清零端(高电平有效).图3-4 74HC390(1/2)内部逻辑框图

秒个位计数单元为10进制计数器,无需进制转换,只需将QA与CPB(下降沿有效)相连即可.CPA(下降没效)与1HZ秒输入信号相连,Q3可作为向上的进位信号与十位计数单元的CPA相连.秒十位计数单元为6进制计数器,需要进制转换.将10进制计数器转换为6进制计数器的电路连接方法如图3-5所示,其中Q2可作为向上的进位信号与分个位的计数单元的CPA相连.图3-5 10进制——6进制计数器转换电路

分个位和分十位计数单元电路结构分别与秒个位和秒十位计数单元完全相同,只不过分个位计数单元的Q3作为向上的进位信号应与分十位计数单元的CPA相连,分十位计数单元的Q2作为向上的进位信号应与时个位计数单元的CPA相连.时个位计数单元电路结构仍与秒或个位计数单元相同,但是要求,整个时计数单元应为12进制计数器,不是10的整数倍,因此需将个位和十位计数单元合并为一个整体才能进行12进制转换.利用1片74HC390实现12进制计数功能的电路如图3-6所示.另外,图3-6所示电路中,尚余-2进制计数单元,正好可作为分频器2HZ输出信号转化为1HZ信号之用.图3-6 12进制计数器电路 4)译码驱动及显示单元

计数器实现了对时间的累计以8421BCD码形式输出,选用显示译码电路将计数器的输出数码转换为数码显示器件所需要的输出逻辑和一定的电流,选用CD4511作为显示译码电路,选用LED数码管作为显示单元电路.5)校时电源电路

当重新接通电源或走时出现误差时都需要对时间进行校正.通常,校正时间的方法是:首先截断正常的计数通路,然后再进行人工出触发计数或将频率较高的方波信号加到需要校正的计数单元的输入端,校正好后,再转入正常计时状态即可.根据要求,数字钟应具有分校正和时校正功能,因此,应截断分个位和时个位的直接计数通路,并采用正常计时信号与校正信号可以随时切换的电路接入其中.图3-7所示即为带有基本RS触发器的校时电路, 图3-7 带有消抖动电路的校正电路 6)整点报时电路

一般时钟都应具备整点报时电路功能,即在时间出现整点前数秒内,数字钟会自动报时,以示提醒.其作用方式是发出连续的或有节奏的音频声波,较复杂的也可以是实时语音提示.根据要求,电路应在整点前10秒钟内开始整点报时,即当时间在59分50秒到59分59秒期间时,报时电路报时控制信号.报时电路选74HC30,选蜂鸣器为电声器件.元器件

1.实验中所需的器材 5V电源.面包板1块.示波器.万用表.镊子1把.剪刀1把.网络线2米/人.共阴八段数码管6个.CD4511集成块6块.CD4060集成块1块.74HC390集成块3块.74HC51集成块1块.74HC00集成块5块.74HC30集成块1块.10MΩ电阻5个.500Ω电阻14个.30p电容2个.32.768k时钟晶体1个.蜂鸣器.2.芯片内部结构图及引脚图

图4-1 7400 四2输入与非门 图4-2 CD4511BCD七段译码/驱动器 图4-3 CD4060BD 图4-4 74HC390D 图4-5 74HC51D 图4-6 74HC30 3.面包板内部结构图

面包板右边一列上五组竖的相通,下五组竖的相通,面包板的左边上下分四组,每组中X,Y列(0-15相通,16-40相通,41-55相通,ABCDE相通,FGHIJ相通,E和F之间不相通.个功能块电路图

一个CD4511和一个LED数码管连接成一个CD4511驱动电路,数码管可从0---9显示,以次来检查数码管的好坏,见附图5-1.图5-1 4511驱动电路

利用一个LED数码管,一块CD4511,一块74HC390,一块74HC00连接成一个十进制计数器,电路在晶振的作用下数码管从0—9显示,见附图5-2.图5-2 74390十进制计数器

利用一个LED数码管,一块CD4511,一块74HC390,一块74HC00和一个晶振连接成一个六进制计数器,数码管从0—6显示,见附图5-3.图5-3 74390六进制计数器 利用一个六进制电路和一个十进制连接成一个六十进制电路,电路可从0—59显示,见附图5-4.图5-4 六十进制电路

利用两个六十进制的电路合成一个双六十进制电路,两个六十进制之间有进位,见附图5-5.图5-5 双六十进制电路

利用CD4060,电阻及晶振连接成一个分频——晶振电路,见附图5-6.图5-6 分频—晶振电路

利用74HC51D和74HC00及电阻连接成一个校时电路,见附图5-7.图5-7 校时电路

利用74HC30和蜂鸣器连接成整点报时电路.见附图5-8.图5-8 整点报时电路

利用两个六十进制和一个十二进制连接成一个时,分,秒都会进位的电路总图,见附图5-9.图5-9 时,分,秒的进位连接图 总接线元件布局简图,见附图6-1 芯片连接图见附图7-1 八,总结

设计过程中遇到的问题及其解决方法.在检测面包板状况的过程中,出现本该相通的地方却未通的状况,后经检验发现是由于万用表笔尖未与面包板内部垂直接触所至.在检测CD4511驱动电路的过程中发现数码管不能正常显示的状况,经检验发现主要是由于接触不良的问题,其中包括线的接触不良和芯片的接触不良,在实验过程中,数码管有几段二极管时隐时现,有时会消失.用5V电源对数码管进行检测,一端接地,另一端接触每一段二极管,发现二极管能正常显示的,再用万用表欧姆档检测每一根线是否接触良好,在检测过程中发现有几根线有时能接通,有时不能接通,把接触不好的线重新接过后发现能正常显示了.其次是由于芯片接触不良的问题,用万用表欧姆档检测有几个引脚本该相通的地方却未通,而检测的导线状况良好,其解决方法为把CD4511的芯片拔出,根据面包板孔的的状况重新调整其引脚,使其正对于孔,再用力均匀地将芯片插入面包板中,此后发现能正常显示,本次实验中还发现一块坏的LED数码管和两块坏的CD4511,经更换后均能正常显示.在连接晶振的过程中,晶振无法起振.在排除线与芯片的接触不良问题后重新对照电路图,发现是由于12脚未接地所至.在连接六进制的过程中,发现电路只能4,5的跳动,后经发现是由于接到与非门的引脚接错一根所至,经纠正后能正常显示.在连接校正电路的过程中,出现时和分都能正常校正时,但秒却受到影响,特别时一较分钟的时候秒乱跳,而不校时的时候,秒从40跳到59,然后又跳回40,分和秒之间无进位,电路在时,分,秒进位过程中能正常显示,故可排除芯片和连线的接触不良的问题.经检查,校正电路的连线没有错误,后用万用表的直流电压档带电检测秒十位的QA,QB,QC和QD脚,发现QA脚时有电压时而无电压,再检测秒到分和分到时的进位端,发现是由于秒到分的进位未拔掉所至.5 在制作报时电路的过程中,发现蜂鸣器在57分59秒的时候就开始报时,后经检测电路发现是由于把74HC30芯片当16引脚的芯片来接,以至接线都错位,重新接线后能正常报时.连接分频电路时,把时个位的QD和时十位的1脚断开,然后时十位的1脚接到晶振的3脚,时十位的3脚接到秒个位的1脚,所连接的电路图无法正常工作,时十位从0-9的跳,时个位只能显示一个0,在这个电路中3脚的分频用到两次,故无法正常显示,因此要把12进制接到74HC390的一个逻辑电路空出来用于分频即可,因此把时十位的CD4511的12,6脚接地,7脚改为接74HC390的5脚,74HC390的3,4脚断开,然后4脚接9脚即可,其中空出的74HC390的3脚就可用于2Hz的分频,分频后变为1Hz,整个电路也到此为正常的数字钟计数.2.设计体会

在此次的数字钟设计过程中,更进一步地熟悉了芯片的结构及掌握了各芯片的工作原理和其具体的使用方法.在连接六进制,十进制,六十进制的进位及十二进制的接法中,要求熟悉逻辑电路及其芯片各引脚的功能,那么在电路出错时便能准确地找出错误所在并及时纠正了.在设计电路中,往往是先仿真后连接实物图,但有时候仿真和电路连接并不是完全一致的,例如仿真的连接示意图中,往往没有接高电平的16脚或14脚以及接低电平的7脚或8脚,因此在实际的电路连接中往往容易遗漏.又例如74HC390芯片,其本身就是一个十进制计数器,在仿真电路中必须连接反馈线才能正常显示,而在实际电路中无需再连接,因此仿真图和电路连接图还是有一定区别的.在设计电路的连接图中出错的主要原因都是接线和芯片的接触不良以及接线的错误所引起的.3.对该设计的建议

此次的数字钟设计重在于仿真和接线,虽然能把电路图接出来,并能正常显示,但对于电路本身的原理并不是十分熟悉.总的来说,通过这次的设计实验更进一步地增强了实验的动手能力.